Samsung skomercjalizuje technologię BSPDN w procesie 2 nm w 2025 roku

Według doniesień medialnych, w zaciętym wyścigu z TSMC i Intelem o opracowanie procesów wytwarzania chipów nowej generacji, Samsung Electronics przyspiesza wdrażanie technologii BackSide Power Delivery Network (BSPDN), dążąc do zintegrowania tej technologii z procesem technologicznym 2 nm do 2025 r., co może zmienić krajobraz rynku foundry.

Posłuchaj
00:00

Według źródeł branżowych cytowanych przez koreańskie media ChosunBiz, Samsung osiągnął lepsze niż oczekiwano wyniki w zakresie rozwoju technologii BSPDN - zmniejszono powierzchnię chipów, jednocześnie zwiększając wydajność i efektywność.

Tradycyjnie projektanci chipów umieszczają linie zasilające na przedniej stronie płytki, aby ułatwić proces produkcyjny. Jednakże w miarę jak obwody stają się coraz bardziej skomplikowane, umieszczanie obwodów i linii zasilających po jednej stronie staje się trudne. Ponadto malejące przerwy między obwodami mogą prowadzić do zakłóceń elektrycznych, co jeszcze bardziej komplikuje projektowanie i produkcję chipów.

W związku z tym BSPDN jawi się jako przełamanie tych ograniczeń. Dzięki liniom zasilającym umieszczonym z tyłu płytki, BSPDN oddziela przestrzeń dla skomplikowanych obwodów od dostarczania mocy, maksymalizując w ten sposób efektywność energetyczną i poprawiając wydajność chipa. Technologia ta może również skutecznie zmniejszyć powierzchnię chipa, ułatwiając dalszą miniaturyzację procesorów aplikacji mobilnych (AP).

Samsung - wspierany przez rozwój BSPDN przekraczający oczekiwania - jest na dobrej drodze do przyspieszenia komercjalizacji w stosunku do pierwotnego terminu określanego na rok 2027. Wstępne raporty wskazywały, że Samsung wdroży technologię BSPDN w procesie 1,7 nm, ale najnowsze doniesienia sugerują wcześniejszą integrację z procesem 2 nm do 2025 r.

Mimo że Samsung robi postępy w rozwoju BSPDN, obecnie uważa się, że to Intel jest liderem w tej dziedzinie. Celem Intela jest rozpoczęcie masowej produkcji z wykorzystaniem technologii BSPDN w 2024 r., przy czym nastąpić ma integracja z chipami wytwarzanymi w procesie 20A (2 nm). Intel stworzył nawet markę "PowerVia", by podkreślić swoje możliwości w zakresie BSPDN. Tymczasem TSMC planuje włączyć technologię BSPDN do swojego procesu o wymiarze charakterystycznym poniżej 2 nm.

Źródło: DigiTimes

Powiązane treści
Rapidus dołącza do imec Core Partner Program w celu rozwoju technologii 2 nm
W Europie będą produkowane chipy w technologii poniżej 2 nm
TSMC wybuduje fabrykę dla chipów w procesie 2 nm
W 2024 roku TSMC rozpocznie masową produkcję układów 2 nm
Wyścig o dominację w technologii 2 nm nabiera tempa
Intel otwiera w Nowym Meksyku zakład Fab 9
TSMC i japońscy partnerzy planują budowę drugiej fabryki półprzewodników
Zobacz więcej w kategorii: Gospodarka
Komunikacja
Leuze wprowadza nowe skanery laserowe LiDAR do precyzyjnego pomiaru konturów
Komunikacja
Lantronix i TD SYNNEX poszerzają współpracę – zaawansowane rozwiązania IIoT i infrastruktury sieciowej dostępne w całej Europie
Produkcja elektroniki
DMASS podsumował 2024 rok
Komponenty
DigiKey i SparkFun współpracują w zakresie dostarczania zestawów robotycznych XRP
Pomiary
Nowa seria ultraszybkich digitalizerów GHz od Spectrum Instrumentation
Produkcja elektroniki
Produkcja półprzewodników według lokalizacji
Zobacz więcej z tagiem: Aktualności
Gospodarka
Contrans współpracuje z EPT
Gospodarka
NXP zamierza zwolnić 1600 pracowników
Gospodarka
POLYN Technology wprowadza innowacyjny zestaw ewaluacyjny do monitorowania opon
Zapytania ofertowe
Unikalny branżowy system komunikacji B2B Znajdź produkty i usługi, których potrzebujesz Katalog ponad 7000 firm i 60 tys. produktów